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Cours

Mise à jour le 30-11-2010

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VHDL :

Introduction : motivations, historique
Méthode de conception: modèles de description
Unités de conception : entité, architecture, configuration, paquetage, corps de paquetage
Les objets : signaux, types, sous types
Les éléments du langage : opérateurs, procédures, fonctions, affectations
Instructions concurrentes : processus, blocs
La généricité
La fonction de résolution
Simulation et validation, réalisation d’un composant de test
Exemples : paquetage standard et exemples de codes VHDL

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